和内存信号时序(使能,时钟,读写,地址,数据),考虑建立时间保持时间,传输延时
2.高速信号的完整性?如何实现端接,解耦怎样处理?
3.一个芯片输入管脚图,分析计算和一个TTL电平连接的电阻阻值范围
4.复位信号的.处理方法,写出你在设计中如何防止复位信号中的抖动?
5.有一个同步帧信号周期为5ms,长度为1us,现在有一个5ns的干扰信号,给定一个EPLD时钟32Mhz,设计一个抗干扰模块.
与外设的读写问题,现在给定两个SDRAM和一个DPRAM,要求画出时钟树,写出设计思路.
开发有哪几步?功能?软件硬件
HDL写一个异步清0锁存器
9.同步逻辑异步逻辑优缺点,多时钟域设计方法,如何保证FPGA有效工作?
笔试题(信号)
进修社
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